Содержание
-
Логические основы компьютера
Базовые логические элементы Автор: Сергеев Евгений Викторович МОУ СОШ №4 г. Миньяра Челябинской области sergeev73@mail.ru http://shk4-minyar.ucoz.ru
-
Базовые логические элементы
Компьютер выполняет арифметические и логические операции при помощи т.н. базовых логических элементов, которые также еще называют вентилями. Вентиль «И» – конъюнктор. Реализует конъюнкцию. Вентиль«ИЛИ» – дизъюнктор. Реализует дизъюнкцию. Вентиль«НЕ» – инвертор. Реализует инверсию
-
Составныеэлементы
Любая логическая операция может быть представлена через конъюнкцию, дизъюнкцию и инверсию Любой сколь угодно сложный элемент компьютера может быть сконструирован из элементарных вентилей
-
Сигналы-аргументы и сигналы-функции
Вентили оперируют с электрическими импульсами: Импульс имеется – логический смысл сигнала «1» Импульса нет – логический смысл сигнала «0» На входы вентиля подаются импульсы – значения аргументов, на выходе вентиля появляется сигнал – значение функции
-
Логическая схема типа «И»(конъюнктор)
1 0 = 0 1 0 A В Электрическая цепь из двух последовательно подключенныхвыключателей
-
Логическая схема типа «ИЛИ»(дизъюнктор)
+ - 1 1 1 v 1 = 1 Электрическая цепь из двух параллельно подключенныхвыключателей
-
Логическая схема типа «НЕ»(инвертор)
+ - + - ¬1 = 0 1 Электрическая цепь с однимавтоматическим выключателем
-
Конъюнктор
На входы конъюнктора подаются сигналы 0 или 1 На выходе конъюнктора появляются сигналы 0 или 1 в соответствии с таблицей истинности
-
Дизъюнктор
На входы дизъюнктора подаются сигналы 0 или 1 На выходе дизъюнктора появляются сигналы 0 или 1 в соответствии с таблицей истинности
-
Инвеpтор
На входы инвертора подаются сигналы 0 или 1 На выходе инвертора появляются сигналы 1 или 0 в соответствии с таблицей истинности
-
Сумматор двоичных чисел
Любое математическое сколь угодно сложное выражение может быть представлено в виде последовательности элементарных математических операций Все математические действия в компьютере сводятся к сложению двоичных чисел Основу микропроцессора составляют сумматоры двоичных чисел
-
Полусумматор. Арифметическое сложение двоичных чисел
В каждом разряде образуется сумма цифр в соответствующих разрядах слагаемых, при этом возможен перенос единицы в старший разряд Без переноса 0000 0001 0000 0010 0 0 0 0 0 0 1 1 С переносом 0000 0011 0000 0010 0 0 0 0 0 1 0 1 + +
-
Обозначим слагаемые через А и В, перенос – через Р, а сумму – через S
Таблица сложения одноразрядных двоичных чисел: 0 0 0 1 0 1 1 0 Очевидно, что Р = А В
-
Получаем формулу для вычисления S
Если сравнить АВcS: то очевидно, что они практически идентичны. Чтобы равенство оказалось полным нужно выражение АВ умножить на ¬Р
-
S = (А В) ¬P (А В) ¬(A B) 0 1 1 1 0 0 0 1 1 1 1 0 0 1 1 0 Теперь, имея элементарные логические выражения, можно построить логическую схему устройства для сложения одноразрядных двоичных чисел (полусумматора)
-
Логическая схема двоичного полусумматора
Полусумматор называется так, потому, что здесь не учитывается перенос единицы из младшего разряда И НЕ И ИЛИ А B А В А В ¬(А В) (А В) ¬(A B) (А В) ¬(A B)
-
Полный одноразрядный сумматор
Должен иметь три входа (А, В и Р0) и два выхода (S и P) 0 0 0 1 0 1 1 1 0 1 1 0 1 0 0 1
-
Формула полного одноразрядного сумматора
Р принимает значение 1 когда хотя бы две из трех переменных равны 1: Р = (А B)(A P0) (B P0) Сумма равна произведению логического сложения (А, В и Р0) на инвертированный перенос ¬Р: S = (А В Р0) ¬Р Это выражение справедливо во всех случаях, кроме одного, когда А, В и Р0 равны 1:
-
Правильное значение суммы – 1. Для ее получения необходимо полученное выражение сложить с произведением этих же переменных: S = (А В Р0) ¬Р (А В Р0)
-
Многоразрядный сумматор
Построен на основе полных одноразрядных сумматоров (по одному на каждый разряд), причем таким образом, чтобы выход (перенос) младшего сумматора был подключен ко входу старшего сумматора
-
Триггер
Важнейшая структурная единица оперативной памяти и регистров процессора Состоит из двух логических элементов «ИЛИ» и двух логических элементов «НЕ»
-
Логическая схема триггера
ИЛИ ИЛИ НЕ НЕ S R Q
-
Работа триггера
В обычном состоянии на входы триггера Sи R подан сигнал «0» и триггер хранит «0». При подаче сигнала «1» на вход S триггер принимает значение на выходе Qзначение «1» При подаче сигнала «1» на вход R триггер возвращается в свое исходное состояние – хранит «0»
Нет комментариев для данной презентации
Помогите другим пользователям — будьте первым, кто поделится своим мнением об этой презентации.